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Vacante: Ingeniero RAM de tren

Tiempo completo @Vacantes Tripalis publicado 1 año ago en Ingenieria
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Trabajo De Detalle

  • Job ID 549112

Descripción Del Trabajo

Descripción general:

Administrar las actividades RAM y los entregables relacionados de acuerdo con los compromisos de QCD en el (los) proyecto (s) / programa (s) para los que está designado.

Apoye el rendimiento de los productos de transporte de Alstom definiendo requisitos de confiabilidad que permitan mejorar su capacidad para cumplir con los objetivos de confiabilidad esperados.

Coordinar los diferentes colaboradores de RAM que trabajan en el Programa/Proyecto para el alcance relevante (Tren o Subsistema).

Aplicar los procesos e instrucciones RAM de ingeniería/transporte de Alstom aplicables.

Responsabilidades específicas del puesto:

Responsable de:

  • Planificar y poner a prueba las actividades de RAM y los productos relacionados en los proyectos/programas para los que está designado de acuerdo con las instrucciones/procesos de RAM aplicables y otros requisitos específicos comprometidos con el Cliente.
  • Planificación y pilotaje de las actividades de RAM en la fase de licitación para evaluar la capacidad y los riesgos del producto previsto de Alstom Transport para cumplir con los requisitos de confiabilidad del cliente y evaluar el presupuesto que se necesitará durante la ejecución del proyecto.
  • Realizar las actividades RAM del proyecto/programa de conformidad con los compromisos de los paquetes de trabajo de QCD.
  • Garantizar la calidad de los entregables de RAM fomenta su aceptación por parte del Cliente (interno o externo) dentro de los límites de los compromisos de Alstom Transport.
  • Evaluar continuamente la capacidad del producto de Alstom Transport para cumplir con el desempeño de Confiabilidad en las fases del proyecto/programa y definir las acciones de confiabilidad necesarias para minimizar los riesgos de Alstom Transport y seguirlos hasta el cierre (Lista de elementos relacionados con la confiabilidad).
  • Informar sobre el progreso de las actividades RAM del proyecto/programa y alertar al PrEM y al N+1 en caso de que surja un problema que pueda afectar el logro de los compromisos de QCD.
  • Anticipar y alertar sobre los posibles problemas de bloqueo con respecto a las expectativas del próximo hito de revisión del diseño de Confiabilidad y ser proactivo en la definición/implementación del plan de resolución relacionado.

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